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十七、基本RS觸發(fā)器

2023-05-02 17:15 作者:UpbeatAchiever  | 我要投稿

目錄

基本RS觸發(fā)器(與非門構(gòu)成)如下圖所示:

基本含義:

R、S觸發(fā)器邏輯表達(dá)式:

真值表、特征表:

1.與非門真值表:

2.基本RS觸發(fā)器特征表:

特征表含義:

那么為什么R、S都為0時(shí)輸出不穩(wěn)定?

時(shí)序圖分析理解:

狀態(tài)1:

狀態(tài)2:

狀態(tài)3:

狀態(tài)4:

狀態(tài)5:

————————————————

基本RS觸發(fā)器(與非門構(gòu)成)如下圖所示:

?


基本含義:

S是Set 的首字母,也就是設(shè)置端。

R 是Reset 的首字母,也就是復(fù)位端。

觸發(fā)器屬于時(shí)序邏輯電路,與組合邏輯電路不同,組合邏輯電路的輸出狀態(tài)只取決于同時(shí)刻的輸入信號(hào)狀態(tài)?;綬S觸發(fā)器把輸出信號(hào)引回到輸入信號(hào),形成一個(gè)反饋。這樣使得輸出信號(hào)的狀態(tài)不但取決于同時(shí)刻輸入信號(hào)的狀態(tài),也與輸出之前的狀態(tài)有關(guān)。

輸出信號(hào)的狀態(tài)就是(Q^(N+1) 次態(tài)) 同時(shí)刻輸入信號(hào)的狀態(tài)就是(S、R) 輸出之前的狀態(tài)就是(Q^N 現(xiàn)態(tài))

R、S觸發(fā)器邏輯表達(dá)式:


真值表、特征表:

1.與非門真值表:


18508a0be6699cae6789a25e2b40fb0b.png

2.基本RS觸發(fā)器特征表:


把上圖RS觸發(fā)器包裝起來就是:



紅色的圈表示R、S均為輸入低電平有效。

特征表含義:

第一行:

R是復(fù)位端,低電平有效,也就是當(dāng)R為0時(shí)有效,當(dāng)S為1(設(shè)置端無效)時(shí),使得輸出Q^(N+1)為0。

第二行:

S是設(shè)置端,低電平有效,也就是當(dāng)S為0時(shí)有效,當(dāng)R為1(復(fù)位端無效)時(shí),使得輸出Q^(N+1)為1。

第三行:

輸入R、S都為1,也就是復(fù)位端、設(shè)置端都有效時(shí)。輸出保持,為Q^N。

證明:

先假設(shè)QN=1,那么QN 非就等于0:

第一個(gè)與非門輸入 1和0,根據(jù)與非門真值表可知,Q^(N+1)輸出為1。

第二個(gè)與非門輸入1和1,根據(jù)與非門真值表可知,Q^(N+1) 非輸出為0。

Q(N+1)=QN,輸出保持不變。

再假設(shè)QN=0,那么QN 非就等于1:

第一個(gè)與非門輸入 1和1,根據(jù)與非門真值表可知,Q^(N+1)輸出為0。

第二個(gè)與非門輸入0和1,根據(jù)與非門真值表可知,Q^(N+1) 非輸出為1。

Q(N+1)=QN,輸出保持不變。

綜合兩次假設(shè):當(dāng)輸入R、S都為1時(shí),輸出保持不變。

第四行:

當(dāng)R、S都為0時(shí)為不穩(wěn)定狀態(tài),運(yùn)用觸發(fā)器時(shí)要盡量避免此狀態(tài)。

當(dāng)R、S都輸入為0時(shí),

根據(jù)與非門的特性,兩個(gè)輸出端都為1。

時(shí)序圖分析理解:


狀態(tài)1:

R、S輸入均為1,輸出保持不變?nèi)匀粸?


狀態(tài)2:

R輸入為1,S輸入為0,輸出置1


狀態(tài)3:

R、S輸入均為1,輸出保持不變?nèi)匀粸?


狀態(tài)4:

R輸入為0,S輸入為1,輸出置0


狀態(tài)5:

R輸入為1,S輸入為0,輸出置1

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原文鏈接:https://blog.csdn.net/zhjysx/article/details/122496323


十七、基本RS觸發(fā)器的評(píng)論 (共 條)

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